PCB EMI設(shè)計規(guī)范步驟

在PCB設(shè)計中最常見的問題就是信號線跨越分割地或電源而產(chǎn)生EMI問題。為規(guī)避這種EMI問題下面深亞電子就為大家介紹一下PCB設(shè)計中EMI設(shè)計的規(guī)范步驟。

一、IC的電源處理

保證每個IC的電源PIN都有一個0.1UF的去耦電容，對于BGA CHIP，要求在BGA的四角分別有0.1UF、0.01UF的電容共8個。對走線的電源尤其要注意加濾波電容，如VTT等。這不僅對穩(wěn)定性有影響，對EMI 也有很大的影響。

二、時鐘線的處理

1.建議先走時鐘線。

2.頻率大于等于66M的時鐘線，每條過孔數(shù)不要超過2個，平均不得超過1.5個。

3.頻率小于66M的時鐘線，每條過孔數(shù)不要超過3個，平均不得超過2.5個

4.長度超過12inch的時鐘線，如果頻率大于20M，過孔數(shù)不得超過2個。

5.如果時鐘線有過孔，在過孔的相鄰位置，在第二層（地層）和第三層（電源層）之間加一個旁路電容、如圖2.5-1所示，以確保時鐘線換層后，參考層（相鄰層）的高頻電流的回路連續(xù)。旁路電容所在的電源層必須是過孔穿過的電源層，并盡可能地靠近過孔，旁路電容與過孔的間距最大不超過300MIL。

6.所有時鐘線原則上不可以穿島。下面列舉了穿島的四種情形。

6.1 跨島出現(xiàn)在電源島與電源島之間。此時時鐘線在第四層的背面走線，第三層(電源層)有兩個電源島，且第四層的走線必須跨過這兩個島.

6.2 跨島出現(xiàn)在電源島與地島之間。此時時鐘線在第四層的背面走線，第三層(電源層)的一個電源島中間有一塊地島，且第四層的走線必須跨過這兩個島。

6.3 跨島出現(xiàn)在地島與地層之間。此時時鐘線在第一層走線，第二層(地層)的中間有一塊地島，且第一層的走線必須跨過地島，相當(dāng)于地線被中斷。

6.4 時鐘線下面沒有鋪銅。若條件限制實在做不到不穿島，保證頻率大于等于66M的時鐘線不穿島，頻率小于66M的時鐘線若穿島，必須加一個去耦電容形成鏡像通路。以圖6.1為例，在兩個電源島之間并靠近跨島的時鐘線，放置一個0.1UF的電容。

7.當(dāng)面臨兩個過孔和一次穿島的取舍時，選一次穿島。

8.時鐘線要遠離I/O一側(cè)板邊500MIL以上，并且不要和I/O線并行走，若實在做不到，時鐘線與I/O 口線間距要大于50MIL。

9.時鐘線走在第四層時，時鐘線的參考層（電源平面）應(yīng)盡量為時鐘供電的那個電源面上，以其他電源面為參考的時鐘越少越好，另外，頻率大于等于66M的時鐘線參考電源面必須為3.3V電源平面。

10.時鐘線打線時線間距要大于25MIL。

11.時鐘線打線時進去的線和出去的線應(yīng)該盡量遠。盡量避免類似圖A和圖C所示的打線方式，若時鐘線需換層，避免采用圖E的打線方式，采用圖F的打線方式。

12.時鐘線連接BGA等器件時，若時鐘線換層，盡量避免采用圖G的走線形式,過孔不要在BGA下面走,最好采用圖H的走線形式。

13.注意各個時鐘信號，不要忽略任何一個時鐘，包括AUDIO CODEC的AC_BITCLK，尤其注意的是FS3-FS0,雖然說從名稱上看不是時鐘，但實際上跑的是時鐘，要加以注意。

14.Clock Chip上拉下拉電阻盡量靠近Clock Chip。